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f877 ch2 registres internes

REGISTRES INTERNESOrganisation de la mémoire La mémoire du PIC F est divisée en deux blocs la mémoire programme et la mémoire data chaque bloc possède son propre bus d ? adresse de telle sorte que l ? accès à chacun des deux blocs peut être réalisé pendant le même cycle d ? horloge La mémoire programme de type FLASH Pour la mémoire programme de type ash La famille PIC F x est constitué d ? un compteur de programme à bits capable d ? adresser un espace mémoire de K x mots Pour les PIC F et F les premiers K x h- FFFh sont physiquement implémentés et pour les PIC F et F les K x h- FFFh sont physiquement implémentés ?gure C ? est dans cet espace mémoire que le programme sera stocké Cette mémoire peut être programmée et e ?acée plusieurs fois ce qui est intéressant pour développer des programmes En e ?et une lecture d ? un PIC vierge donne des x FFF en binaire B ? ? soit bits Une instruction est codée sur mot soit bits Accéder à des adresses supérieures à l ? espace physiquement implémenté entra? ne une redondance c ? est à dire pour le F les adresses h et h pointent à la même case mémoire Le vecteur reset et le vecteur d ? interruption sont respectivement casés dans les adresses h et h Figure Architecture de la mémoire programme C La mémoire EEPROM La mémoire EEPROM Electrical Erasable Programmable Read Only Memory est constituée de octets h-FFh qui peuvent être lus ou écrits a partir du programme Ces octets sont conservés après une coupure de courant et sont très utiles pour conserver des paramètres semi-permanents Leur utilisation implique une procédure spéciale La mémoire RAM La mémoire RAM Random Access Memory est celle qu ? on utilise pour stocker des données temporaires Cette mémoire est partagée en deux parties Un premier espace mémoire pour les registres spéciaux SFR Special Function Register et un second comme RAM statique pour les registres à usage général GPR General Purpose Register Les SFRs sont utilisés pour le control du PIC Tout cet espace mémoire est organisé sous forme de quatre banques pour les deux types de registres SFRs et GPRs L ? accès à l ? une des deux banques nécessite l ? utilisation des bits de control RP et RP qui font partie du registre STATUS tableau La zone libre GPRs est constitué de octets pour les quatre banques h- Fh F hFFh h- Fh ou F h- FFh ne forment qu ? un seul espace c ? est à dire adresser h F ou F h entra? ne une sélection de la même case mémoire La totalité de l ? espace mémoire libre peut être adressé directement en utilisant une adresse absolue pour chaque registre ou bien indirectement via le registre FSR File Select Register C les zones non utilisées Tableau architecture de la RAM CLa partie supérieure spéci ?e tous les