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Faculté de Technologie Master I - Réseaux de Télécommunications Département de

Faculté de Technologie Master I - Réseaux de Télécommunications Département de Génie Electrique (ATE) 2019/2020 UEF 12.12 - DSP et FPGA Devoir N°01 Nom : ................................................ Spécialité : ........................................ Groupe : ............................................... E-mail : .............................................. Questionnaires (QCM, QCU) « Choisissez "les bonnes réponses"» 1- Parmi ces dispositifs lequel fait partie de la technologie SPLD ? PLA FPGA ASIC GAL 2- Choisissez les bonnes réponses ? Les SPLDs sont des dispositifs avec une matrice OR alimentant une matrice AND. Les SPLDs sont des dispositifs avec une matrice AND alimentant une matrice OR. La différence entre les dispositifs SPLDs étant que l'un ou les deux matrices sont programmables. 3- Qui est à l'origine de la conception des PROMs ? Microchip Texas Instruments Analog Devices lattice semiconductor Corporation 4- La structure ci-dessous du dispositif PAL est-il correcte ? "La matrice AND fixe et la matrice OR programmable" Vrai Faux 1 5- Quel est le dispositif utilisant la méthode de destruction de fusible ? PAL DSP ASIC GAL 6- GAL est-il similaire à un PAL avec des macrocellules logiques de sortie (OLMC) ? Vrai Faux 7- Quels sont les éléments qui composent l'architecture d'un GAL ? L'architecture GAL comporte 2 éléments seulement : un réseau ET fixe, un réseau OU reprogrammable. L'architecture GAL comporte 3 éléments : un réseau ET fixe, un réseau OU reprogrammable et une logique de sortie reprogrammable. L'architecture GAL comporte 3 éléments : un réseau ET reprogrammable, un réseau OU fixe et une logique de sortie reprogrammable. 8- Que signifie l'acronyme TTL? TTL (en Anglais) : TTL (en Français) : 9- Que signifie l'acronyme DSP? DSP (en Anglais) : DSP (en Français) : 10- Que signifie l'acronyme FPGA? FPGA (en Anglais) : FPGA (en Français) : 2 uploads/Ingenierie_Lourd/ devoir-n001-pld.pdf