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Corrige examen fpga 2012 2013 1

ISET DE GABES II N ENSEIGNANT CLASSE DATE DUREE DOCUMENTS M TAYARI LASSAAD AII Le h mn Non autorisés AU sem EXAMEN FPGA DSP NOM ? ? ? ? ? ? ? ? PRENOM ? ? ? ? ? ? ? ? ? ------------------------------------------------------------------------------------------------------------------------ Exercice n points Types de PLDs Indiquez pour chacune des expressions suivantes quelle technologie cible lui correspond le mieux dans la liste suivante FPGA CPLD PAL PLA EPLD ou FPGA-plateforme PSOC Dispositifs logiques programmables ayant la plus haute densité CPLD Dispositifs logiques programmables complexes le plus souvent con ?gurables via une mémoire vive statique FPGA Dispositifs logiques programmables complexes plutôt combinatoires que séquentiels PLA Dispositifs logiques programmables simples avec matrice-ET et matrice-OU programmables EPLD Dispositifs logiques programmables complexes formés de ressources logiques programmables en plus de noyau x dur s de microprocesseur et ou d ? autres ressources spécialisées FPGA- plateforme PSOC Dispositifs logiques programmables complexes dont les délais entrée-sortie sont prévisibles EPLD Exercice n points Modélisation et styles en VHDL Soit la description VHDL suivante entity exercice port x x x sel in stdlogic y out stdlogic end entity exercice architecture archi of exercice is signal a b c d e f std logic begin a x or x b x and x c x and a d b or c e x xor x f x xor e P process d f sel begin if sel ? ? then y d else y f end if end process P end architecture archi Page CNe rien écrire ici ? ----------------------------------------------------------------------------------------------------------------------- Tracez à partir d ? éléments de base le schéma correspondant logigramme X X X SEL U XOR U AND a U XOR b U e U AND XOR U d OR c U AND U A U AND P U OR Y Cette description est-elle structurale ou comportementale Justi ?ez Description comportementale car le système est décrit par des équations et des comportements Le processus P est-il combinatoire ou séquentiel Justi ?ez Le processus P est-il combinatoire car il n ? est pas par une horloge et ne contient pas des bascules Quel est selon vous la fonction de ce circuit Additonneur complet bit Y X X X si sel et Y Rentenu de X X X si sel Page CExercice n points Soit le programme ci-contre Entity prog is port A in stdlogicvector downto B in stdlogicvector downto S in stdlogicvector downto R out stdlogicvector downto End prog Architecture behv of prog is process A B S begin case S is when R A B when R A - B when R A and B when R A or B when others R XXXXXXXX end case End process End behv Dessiner un schéma synoptique pour ce circuit Quel est selon vous la fonction de ce circuit Unité Arithmétique et Logique UAL Page CExercice n points O Pour le circuit ci-dessus compléter le programme VHDL correspondant ci-dessous Library ieee Use ieee stdlogic all Entity exercice is port A in stdlogic B in stdlogic SEL