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Bas el num EL T Bases en électronique numérique Statut Obligatoire ESIEE re année T er semestre Horaires Horaire Cours Horaire TD Horaire TP Horaire P Langue s de l'unite enseignee ANGLAISE Crédits ECTS FRANCAISE Responsable s EXERTIER Anne exertiea esiee

EL T Bases en électronique numérique Statut Obligatoire ESIEE re année T er semestre Horaires Horaire Cours Horaire TD Horaire TP Horaire P Langue s de l'unite enseignee ANGLAISE Crédits ECTS FRANCAISE Responsable s EXERTIER Anne exertiea esiee fr Objectif s Acquérir les base de l ? électronique numérique codages d ? entiers multiplexeurs notions de registres compteurs synchrones synthèse de machines de Moore Compétences - Etre capable de coder un nombre entier en code binaire naturel en code complément à ou en BCD - Etre capable d ? interpréter la documentation technique en anglais d ? un composant logique - A partir de la description d ? une fonction combinatoire être capable de concevoir le schéma portes - Etre capable de concevoir le schéma de registres et de compteurs - A partir de son diagramme d ? états être capable de concevoir le schéma d ? une machine d ? états de Moore - Savoir faire une saisie de schémas sous ISE assigner des ports et con ?gurer un FPGA Pré-requis - Conna? tre les symboles et les fonctions booléennes des portes logiques suivantes inverseur et non et ou non ou-exclusif et non ou-exclusif - Etre capable de simpli ?er une fonction logique par la méthode des tableaux de Karnaugh - Etre capable de représenter un schéma logique logigramme à partir d'une équation et vice-versa Contenu et planning des enseignements Codage et logique combinatoire Codage d'entiers code binaire naturel code complément à et BCD Compléments de logique combinatoire multiplexeurs parité encodeurs Datasheet reading Logique séquentielle Bascule DFF Registres et compteurs Machines d'états machine de Moore avec encodage arbitraire des états Prise en mains de la carte et des outils de développement FPGA Développement d'un système numérique simple sur FPGA C T D T P P Nature de l'évaluation Rapports de TP Devoir Examen écrit Commentaire Durée Coef Bibliographie Documents de références Thomas L Floyd Systèmes numériques chap à et à R Goulet N Richard Electronique numérique et séquentielle chap Dunod Moyens pédagogiques particuliers - maquette pédagogique - carte de développement FPGA Spartan - logiciel ISE Xilinx CEL T Approche système de l'electronique numérique Statut Obligatoire ESIEE re année T er semestre Horaires Horaire Cours Horaire TD Horaire TP Horaire P Langue s de l'unite enseignee FRANCAISE Crédits ECTS Responsable s RIPOLL Christian ripollc esiee fr Objectif s Permettre aux étudiants de comprendre l'architecture des circuits programmables et notamment des FPGAs Maitriser la programmation VHDL de base et avancée Être capable de maitriser le ot de conception jusqu'à l'implantation sur la cible FPGA Altéra Quartus DE Compétences Maitrise de la logique combinatoire et séquentielle Maitrise de l'environnement de développement Altéra Quartus DE Connaissance de la programmation VHDL Pré-requis Logique combinatoire et séquentielle EL T Contenu et planning des enseignements Généralités sur les circuits programmables et rappels de logiques élémentaires Prise en main de la cha? ne de CAO Altera Quartus exemples de description à base de composant de la bibliothèque VHDL de Base VHDL de Base VHDL et logique séquentielle